ASoC: fsl_ssi: add CCSR_SSI_SOR to volatile register list
authorCaleb Crome <caleb@crome.org>
Mon, 25 Apr 2016 18:36:18 +0000 (11:36 -0700)
committerMark Brown <broonie@kernel.org>
Fri, 29 Apr 2016 10:44:53 +0000 (11:44 +0100)
commit3cc6185bcccff32df41faa97d592a99d258db185
tree0d0fc1cb279bec5caccdf4fd5888967b1570e37b
parentf55532a0c0b8bb6148f4e07853b876ef73bc69ca
ASoC: fsl_ssi: add CCSR_SSI_SOR to volatile register list

The CCSR_SSI_SOR is a register that clears the TX and/or the RX fifo
on the i.MX SSI port.  The fsl_ssi_trigger writes this register in
order to clear the fifo at trigger time.

However, since the CCSR_SSI_SOR register is not in the volatile list,
the caching mechanism prevented the register write in the trigger
function.  This caused the fifo to not be cleared (because the value
was unchanged from the last time the register was written), and thus
causes the channels in both TDM or simple I2S mode to slip and be in
the wrong time slots on SSI restart.

This has gone unnoticed for so long because with simple stereo mode,
the consequence is that left and right are swapped, which isn't that
noticeable.  However, it's catestrophic in some systems that
require the channels to be in the right slots.

Signed-off-by: Caleb Crome <caleb@crome.org>
Suggested-by: Arnaud Mouiche <arnaud.mouiche@invoxia.com>
Reviewed-by: Fabio Estevam <fabio.estevam@nxp.com>
Acked-by: Nicolin Chen <nicoleotsuka@gmail.com>
Signed-off-by: Mark Brown <broonie@kernel.org>
sound/soc/fsl/fsl_ssi.c